Multiplier
所属分类：VHDL/FPGA/Verilog
开发工具：VHDL
文件大小：3KB
下载次数：6
上传日期：2009-12-13 12:23:39
上 传 者：
yanghaitao8023
说明： 基于VHDL语言，实现串并乘法器设计主程序
(Based on the VHDL language, to achieve the main program string and Multiplier Design)
文件列表:
串并乘法器设计程序\multiplier\full_adder.vhd (513, 2006-08-21)
串并乘法器设计程序\multiplier\multiplier.vhd (1347, 2006-08-21)
串并乘法器设计程序\multiplier\myand2.vhd (323, 2006-08-21)
串并乘法器设计程序\multiplier\mydff.vhd (505, 2006-08-21)
串并乘法器设计程序\multiplier\mypackage.vhd (996, 2006-08-22)
串并乘法器设计程序\multiplier\pipe.vhd (851, 2006-08-21)
串并乘法器设计程序\multiplier (0, 2009-12-13)
串并乘法器设计程序 (0, 2009-12-13)
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