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multiplier
multiplier pipelined multiplier 8位乘法器 流水乘法器 verilog 8位乘法 
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所属分类：VHDL/FPGA/Verilog
开发工具：Others
文件大小：15KB
下载次数：21
上传日期：2010-02-23 15:28:58
上 传 者：howard_leon
说明：  8位乘8位的流水乘法器verilog实现
(8-bit x 8-bit Pipelined Multiplier)
文件列表:
multiplier.pdf (33247, 2001-07-11)
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