Verilog
所属分类：VHDL/FPGA/Verilog
开发工具：VHDL
文件大小：536KB
下载次数：53
上传日期：2010-08-02 13:10:16
上 传 者：
mingboshui
说明： Verilog数字系统设计教程夏宇闻例题源文件
(Verilog Digital System Design Education Chengxia Yu Wen example source file)
文件列表:
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\下册例题\关于下册例题的说明.doc (19968, 2004-08-28)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\下册例题\练习1-9.doc (98304, 2004-10-14)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\下册例题\练习10.doc (46080, 2004-08-27)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\下册例题\练习11.doc (114688, 2004-08-27)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\下册例题\练习12.doc (54784, 2004-08-27)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\关于上册例题的说明.doc (19968, 2004-10-14)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第10章例题.doc (48128, 2004-10-14)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第11章例题.doc (30208, 2004-08-27)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第12章例题.doc (51712, 2004-08-27)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第13章例题.doc (71680, 2004-08-27)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第14章例题.doc (67072, 2004-08-27)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第15章例题.doc (65536, 2004-08-27)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第16章例题.doc (108544, 2004-08-27)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第18章例题.doc (180733, 2004-08-27)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第2章例题.doc (39424, 2004-10-14)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第4章例题.doc (34816, 2004-08-27)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第5章例题.doc (100864, 2004-08-27)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第6章例题.doc (82432, 2004-08-27)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第7章例题.doc (65024, 2004-08-27)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第8章例题.doc (174592, 2004-08-26)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第9章例题.doc (36352, 2004-08-27)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第17章例题\RiscCpu\accum.v (350, 2004-10-13)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第17章例题\RiscCpu\addr_decode.v (507, 2004-10-13)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第17章例题\RiscCpu\adr.v (345, 2004-10-13)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第17章例题\RiscCpu\alu.v (846, 2004-10-13)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第17章例题\RiscCpu\clk_gen.v (2822, 2004-10-13)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第17章例题\RiscCpu\counter.v (493, 2004-10-13)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第17章例题\RiscCpu\cpu.v (2251, 2004-10-13)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第17章例题\RiscCpu\cputop.v (6720, 2004-10-13)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第17章例题\RiscCpu\datactl.v (307, 2004-10-13)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第17章例题\RiscCpu\machine.v (3884, 2004-10-13)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第17章例题\RiscCpu\machinectl.v (351, 2004-10-13)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第17章例题\RiscCpu\ram.v (336, 2004-10-13)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第17章例题\RiscCpu\register.v (745, 2004-10-13)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第17章例题\RiscCpu\rom.v (220, 2004-10-13)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第17章例题\RiscCpu\test1.dat (442, 2004-10-13)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第17章例题\RiscCpu\test1.pro (3222, 2004-10-13)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第17章例题\RiscCpu\test2.dat (442, 2004-10-13)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第17章例题\RiscCpu\test2.pro (1395, 2004-10-13)
Verilog数字系统设计教程夏宇闻例题源文件\例题源文件\上册例题\第17章例题\RiscCpu\test3.dat (494, 2004-10-13)
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