SDRAM-control
所属分类：VHDL/FPGA/Verilog
开发工具：VHDL
文件大小：2758KB
下载次数：6
上传日期：2010-11-26 21:46:34
上 传 者：
jinwenjinwen
说明： SDRAM控制器的Verilog源代码，主要用于SDR-SDRAM
(SDRAM controller)
文件列表:
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\doc\read_me.doc (24576, 2005-11-22)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\doc\SDRAM.doc (417280, 2005-12-15)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\doc\sdr_sdram.pdf (917283, 2002-09-02)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\altera_mf.v (1139393, 2004-11-28)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\Command.v (17532, 2005-06-18)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\control_interface.v (8494, 2004-11-28)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\mt48lc2m32b2.v (50092, 2004-09-03)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\Params.v (935, 2005-06-14)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\sdram_test.cr.mti (4318, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\sdram_test.mpf (23380, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\sdram_test.wlf (57344, 2005-11-22)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\sdram_test_tb.v (7397, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\transcript (4605, 2005-12-15)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\vsim.wlf (57344, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\wave.do (2616, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\work\@a@l@t@e@r@a_@d@e@v@i@c@e_@f@a@m@i@l@i@e@s\verilog.asm (28793, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\work\@a@l@t@e@r@a_@d@e@v@i@c@e_@f@a@m@i@l@i@e@s\_primary.dat (2947, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\work\@a@l@t@e@r@a_@d@e@v@i@c@e_@f@a@m@i@l@i@e@s\_primary.vhd (104, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\work\@m@f_pll_reg\verilog.asm (4304, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\work\@m@f_pll_reg\_primary.dat (478, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\work\@m@f_pll_reg\_primary.vhd (354, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\work\@m@f_ram7x20_syn\verilog.asm (26147, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\work\@m@f_ram7x20_syn\_primary.dat (2141, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\work\@m@f_ram7x20_syn\_primary.vhd (586, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\work\@m@f_stratixii_pll\verilog.asm (596560, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\work\@m@f_stratixii_pll\_primary.dat (52333, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\work\@m@f_stratixii_pll\_primary.vhd (6750, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\work\@m@f_stratix_pll\verilog.asm (753435, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\work\@m@f_stratix_pll\_primary.dat (72503, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\work\@m@f_stratix_pll\_primary.vhd (8453, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\work\alt3pram\verilog.asm (147437, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\work\alt3pram\_primary.dat (10137, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\work\alt3pram\_primary.vhd (1938, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\work\altaccumulate\verilog.asm (53145, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\work\altaccumulate\_primary.dat (3891, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\work\altaccumulate\_primary.vhd (923, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\work\altcam\verilog.asm (600522, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\work\altcam\_primary.dat (47018, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\work\altcam\_primary.vhd (1731, 2005-12-17)
基于FPGA对sdram控制器的设计（VERILOG语言）\sdram_control\sim\work\altcdr_rx\verilog.asm (155436, 2005-12-17)
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