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code_clk_nco

所属分类：VHDL/FPGA/Verilog
开发工具：VHDL
文件大小：1KB
下载次数：3
上传日期：2016-04-01 10:04:19
上传者：王权富贵哈哈哈

说明：码时钟发生器，可灵活配置参数，根据比例得到自己所需的码时钟，可用于扩频通信
(CODE CLK MODULE CDMA )

文件列表:

code_clk_nco.vhd (1394, 2016-03-14)

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