adder-VerilogHDL
所属分类：VHDL/FPGA/Verilog
开发工具：VHDL
文件大小：3KB
下载次数：26
上传日期：2011-04-12 16:11:59
上 传 者：
fengyuliuxin
说明： 各种加法器的VerilogHDL语言编写的包括普通加法器，串行进位加法器，超前进位加法器等
(Adder VerilogHDL various languages, including ordinary adder, serial carry adder, CLA, etc.)
文件列表:
新建文件夹2\adder8.v (226, 2011-04-10)
新建文件夹2\adder8.v.bak (225, 2011-04-10)
新建文件夹2\adder8_2.v (417, 2011-04-10)
新建文件夹2\adder8_2.v.bak (437, 2011-04-10)
新建文件夹2\Advance_carry_adder.v (444, 2011-04-10)
新建文件夹2\carry_skip_adder.v (1509, 2011-04-10)
新建文件夹2\serial_carry_adder.v (390, 2011-04-10)
新建文件夹2 (0, 2011-04-12)
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