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所属分类：VHDL/FPGA/Verilog
开发工具：Verilog
文件大小：15KB
下载次数：3
上传日期：2017-12-31 18:04:40
上 传 者：
羽霜梦琳
说明： 内有关于循环码的编码器的程序语言，可用quartus ii打开
(There is a program language on the encoder of the loop code, which can be opened with Quartus II)
文件列表:
循环码编码器verilog实现\循环码编码器\1.bmp (1073718, 2008-02-17)
循环码编码器verilog实现\循环码编码器\2.bmp (1066038, 2008-02-17)
循环码编码器verilog实现\循环码编码器\crc_3.txt (3108, 2008-02-17)
循环码编码器verilog实现\循环码编码器\crc_3_testbench.txt (846, 2008-02-17)
循环码编码器verilog实现\循环码编码器\crc_3.v (2970, 2008-02-17)
循环码编码器verilog实现\循环码编码器\crc_3_test.v (806, 2008-02-17)
循环码编码器verilog实现\循环码编码器 (0, 2008-03-02)
循环码编码器verilog实现 (0, 2008-03-02)
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