adder_design_systemc
所属分类：VHDL/FPGA/Verilog
开发工具：LINUX
文件大小：1KB
下载次数：0
上传日期：2018-06-08 09:34:41
上 传 者：
Ysmikler
说明： 一个简单的半加器和全加器systemc实现。
(A simple half adder and full adder SystemC implementation.)
文件列表:
full_adder.cpp (145, 2003-03-24)
full_adder.h (672, 2003-03-24)
half_adder.cpp (295, 2003-03-24)
half_adder.h (554, 2003-03-24)
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