RISC
所属分类：VHDL/FPGA/Verilog
开发工具：Verilog
文件大小：4KB
下载次数：8
上传日期：2019-06-16 23:07:39
上 传 者：
Phystan
说明： URISC的RTL级设计，Verilog代码
(Design: URISC RTL Verilog)
文件列表:
RISC\datapath.v (3688, 2019-06-10)
RISC\datapath.v.bak (3899, 2019-06-10)
RISC\urisc.v (2399, 2019-06-10)
RISC\urisc.v.bak (2424, 2019-06-10)
RISC\urisc_controller.v (4526, 2019-06-10)
RISC\urisc_ram.v (1009, 2019-06-10)
RISC\urisc_ram.v.bak (863, 2019-06-10)
RISC\urisc_test.v (491, 2019-06-10)
RISC\urisc_test.v.bak (489, 2019-06-10)
RISC (0, 2019-06-10)
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