实战训练6 16位乘法器芯片设计
所属分类：VHDL/FPGA/Verilog
开发工具：C/C++
文件大小：507KB
下载次数：0
上传日期：2020-04-29 11:16:12
上 传 者：
zui136
说明： 实战训练6 16位乘法器芯片设计，硬件乘法器设计，可以参考
(For the design of 16 bit multiplier chip and hardware multiplier for practical training, please refer to)
文件列表:
实战训练6 16位乘法器芯片设计\db\logic_util_heursitic.dat (12672, 2010-06-29)
实战训练6 16位乘法器芯片设计\db\mux16.(0).cnf.cdb (10880, 2010-06-29)
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实战训练6 16位乘法器芯片设计\db\mux16.tan.qmsg (38223, 2010-06-29)
... ...
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