IIR
所属分类：VHDL/FPGA/Verilog
开发工具：VHDL
文件大小：1KB
下载次数：71
上传日期：2012-05-04 20:07:57
上 传 者：
BillJane
说明： 环路滤波器的FPGA实现，使用VERILOG语言，ISE13.2编译环境
(The loop filter FPGA realizing, use VERILOG language, ISE13.2 compile environment)
文件列表:
IIR.v (1548, 2012-04-12)
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