timecontrol
所属分类:VHDL/FPGA/Verilog
开发工具:Windows_Unix
文件大小:1KB
下载次数:4
上传日期:2012-05-17 13:08:04
上 传 者:
562376
说明: verilog 语言实现巴克码和写串行数据,对PLL进行配置。
(using verilog to generate bakema and write series datas for PLL conifgure.)
文件列表:
timecontrol.v (10051, 2012-05-14)
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