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vhdl 数字钟 verilog clock verilog 数字钟 verilog 程序

所属分类：VHDL/FPGA/Verilog
开发工具：Unix_Linux
文件大小：5KB
下载次数：47
上传日期：2006-06-02 10:30:31
上传者：bingkou

说明：使用Verilog语言编写的数字钟程序.有慢校时,快校时,闹钟等功能.
(use Verilog language prepared by the digital clock procedures. Schools are slow, quick school, alarm clock functions.)

文件列表:

clockv1。0\clock.v (2540, 2006-03-15)
clockv1。0\control.v (4468, 2006-03-15)
clockv1。0\count12.v (577, 2006-03-13)
clockv1。0\count60.v (611, 2006-03-13)
clockv1。0\decode4_7.v (580, 2006-03-13)
clockv1。0\devfreq1000.v (428, 2006-03-13)
clockv1。0\devfreq1hz.v (390, 2006-03-13)
clockv1。0\devfreq1khz.v (169, 2006-03-13)
clockv1。0\devfreq32.v (443, 2006-03-13)
clockv1。0\display.v (631, 2006-03-13)
clockv1。0\leddisplay.v (889, 2006-03-13)
clockv1。0\qudou.v (539, 2006-03-15)
clockv1。0 (0, 2006-03-15)

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