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SDRAM-design-FPGA-altera

sdram FPGA SDRAM sdram fpga altera vhdl sdram altera

所属分类：VHDL/FPGA/Verilog
开发工具：VHDL
文件大小：703KB
下载次数：7
上传日期：2012-12-06 16:45:36
上传者：zhaochao288

说明： SDRAM design FPGA altera
(SDRAM design FPGA altera.)

文件列表:

标准SRD SDRAM控制器参考设计，altera提供\sdr_sdram.pdf (917283, 2002-09-02)
标准SRD SDRAM控制器参考设计，altera提供\simulation\sdr_sdram_tb.v (22444, 2000-07-12)
标准SRD SDRAM控制器参考设计，altera提供\source\altclklock.v (8543, 2000-06-12)
标准SRD SDRAM控制器参考设计，altera提供\source\Command.v (17328, 2000-07-28)
标准SRD SDRAM控制器参考设计，altera提供\source\compile_all.v (206, 2000-05-19)
标准SRD SDRAM控制器参考设计，altera提供\source\control_interface.v (8463, 2000-07-28)
标准SRD SDRAM控制器参考设计，altera提供\source\Params.v (935, 2000-07-06)
标准SRD SDRAM控制器参考设计，altera提供\source\PLL1.v (4754, 2000-05-23)
标准SRD SDRAM控制器参考设计，altera提供\source\sdr_data_path.v (2747, 2000-07-28)
标准SRD SDRAM控制器参考设计，altera提供\source\sdr_sdram.v (6942, 2000-07-28)
标准SRD SDRAM控制器参考设计，altera提供\doc (0, 2012-09-17)
标准SRD SDRAM控制器参考设计，altera提供\simulation (0, 2012-09-17)
标准SRD SDRAM控制器参考设计，altera提供\source (0, 2012-09-17)
标准SRD SDRAM控制器参考设计，altera提供 (0, 2012-09-17)

SDR SDRAM Controller v1.1 readme.txt This readme file for the SDR SDRAM Controller includes information that was not incorporated into the SDR SDRAM Controller White Paper v1.1. The PLL is targeted at APEX(TM) devices. Please regenerate for your chosen architecture. Last updated September, 2002 Copyright 2002 Altera Corporation. All rights reserved.

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