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所属分类：VHDL/FPGA/Verilog
开发工具：VHDL
文件大小：1KB
下载次数：1
上传日期：2013-07-18 16:07:25
上 传 者：
liyongchao
说明： 通过verilog hdl语言完成对积分梳妆滤波器的设计
(By verilog hdl language used to complete the design of the integrator comb filter)
文件列表:
积分梳状滤波器(CIC)设计\cic3_decimator.v (1622, 2006-12-05)
积分梳状滤波器(CIC)设计 (0, 2013-01-27)
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