powerlink
所属分类：VHDL/FPGA/Verilog
开发工具：VHDL
文件大小：2869KB
下载次数：92
上传日期：2014-04-28 10:55:45
上 传 者：
wholered
说明： powerlink 次站VHDL源码，可以实现4中不同的模式，基于xilinx平台。
(powerlink slave VHDL sourcecode，which is based on Xilinx platform.)
文件列表:
powerlink\pcores\axi_powerlink_v0_28_a\data\axi_powerlink_v2_1_0.mdd (2554, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\data\axi_powerlink_v2_1_0.mpd (35799, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\data\axi_powerlink_v2_1_0.mui (25421, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\data\axi_powerlink_v2_1_0.pao (4456, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\data\axi_powerlink_v2_1_0.tcl (40201, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\doc\01_POWERLINK-IP-Core_Xilinx.pdf (349253, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\doc\02_POWERLINK-IP-Core_Generic.pdf (1004357, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\doc\03_OpenMAC.pdf (310806, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\axi_powerlink.vhd (84322, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\lib\addr_decoder.vhd (3144, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\lib\edgedet.vhd (3158, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\lib\memMap.vhd (3161, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\lib\req_ack.vhd (3512, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\lib\slow2fastSync.vhd (3726, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\lib\sync.vhd (2976, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\openFILTER.vhd (11093, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\openHUB.vhd (6522, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\openMAC.vhd (51955, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\openMAC_16to32conv.vhd (6853, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\openMAC_cmp.vhd (4584, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\openMAC_DMAFifo_Xilinx\async_fifo_ctrl.vhd (5664, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\openMAC_DMAFifo_Xilinx\fifo_read.vhd (5197, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\openMAC_DMAFifo_Xilinx\fifo_write.vhd (5192, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\openMAC_DMAFifo_Xilinx\n_synchronizer.vhd (3499, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\openMAC_DMAFifo_Xilinx.vhd (6421, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\openMAC_DMAmaster\dma_handler.vhd (8114, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\openMAC_DMAmaster\ipif_master_handler.vhd (11074, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\openMAC_DMAmaster\master_handler.vhd (14784, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\openMAC_DMAmaster.vhd (22013, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\openMAC_DPR_Altera_qsys.vhd (9499, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\openMAC_DPR_Xilinx.vhd (11468, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\openMAC_Ethernet.vhd (39365, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\openMAC_phyAct.vhd (4237, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\openMAC_PHYMI.vhd (5745, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\openMAC_rmii2mii.vhd (9282, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\pdi.vhd (53242, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\pdi_apIrqGen.vhd (4783, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\pdi_controlStatusReg.vhd (20196, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\pdi_dpr_Xilinx.vhd (3605, 2013-11-09)
powerlink\pcores\axi_powerlink_v0_28_a\hdl\vhdl\pdi_event.vhd (7403, 2013-11-09)
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