shuzimiaobiao

所属分类:VHDL/FPGA/Verilog
开发工具:matlab
文件大小:1KB
下载次数:226
上传日期:2007-07-05 23:15:48
上 传 者qihuolin
说明:  用verilog实现了一个数字秒表的设计
(verilog achieved using a digital stopwatch Design)

文件列表:
数字跑表.txt (1438, 2007-07-05)

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