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数字钟数字钟 VHDL vhdl 数字钟 digitalclock 数码管 VHDL

所属分类：VHDL/FPGA/Verilog
开发工具：VHDL
文件大小：5KB
下载次数：68
上传日期：2008-06-26 19:37:40
上传者：不得其解

说明：这是一个数字钟的VHDL实现.采用八段数码管显示！ --可调闹铃，可校时。
(This is a digital clock to achieve the VHDL. Using eight digital tube display!- Adjustable alarm can be school.)

文件列表:

digital clock.vhd (40960, 2008-06-26)

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