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aes_cipher_top

所属分类：单片机开发
开发工具：VHDL
文件大小：3KB
下载次数：6
上传日期：2009-05-17 09:22:59
上传者：callhua1

说明：密钥扩展模块的接口如图4.4。clk为系统时钟，kld为输入的加载信号，key为输入的128位密钥数据，wo_0, wo_1, wo_2, wo_3分别为输出的密钥列

文件列表:

aes_cipher_top.v (10434, 2009-04-14)

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