clk_vhdl
所属分类:VHDL/FPGA/Verilog
开发工具:Others
文件大小:637KB
下载次数:75
上传日期:2009-05-31 12:49:28
上 传 者:
kg21kg
说明: Quartus II工程压缩文件,是一个典型的基于FPGA的数字钟工程项目,有50MHz分频、计数、译码等模块。采用VHDL语言编写。
(Quartus II project files, is a typical FPGA-based digital clock project, there are sub-50MHz frequency, counting, decoding modules. Using VHDL language.)
文件列表:
clk_vhdl.qar (687998, 2006-04-03)
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