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所属分类：VHDL/FPGA/Verilog
开发工具：VHDL
文件大小：1KB
下载次数：19
上传日期：2009-11-22 04:30:45
上 传 者：
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说明： Verilog code calculator, add, rest, multiply, and increment
文件列表:
clkseg.v (155, 2009-11-16)
digitos.v (554, 2009-11-16)
mux_deco.v (639, 2009-11-16)
Ula_final.v (406, 2009-10-22)
calculadora.v (506, 2009-10-26)
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