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cpld decode
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1.
qiduanxianshiyima
Defined_hyg
在 2012-01-05 22:48:35 上传
说明:利用译码程序在FPGA/CPLD中实现16进制数的译码显示.通过EDA原理图设计方法利用prim库中7448芯片进行7段译码显示
开发平台:
VHDL
| 大小:
50KB
| 下载
4次