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single_port_ram.zip - Single port RAM file VHDL source code,2014-07-10 04:47:02,下载2次
pipeline-RiSC.zip - Pipelined RiSC with testbench,2014-07-10 04:45:47,下载3次
BasicRSA.zip - VHDL RSA cypher for FPGA,2014-07-10 04:44:11,下载12次

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