帅帅的凯

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Quartus II TimeQuest时序分析器说明书.zip - Quartus II TimeQuest 时序分析器说明书;这本手册包含一组设计场景、约束指南以及相关建议。您应该熟悉 TimeQuest Timing Analyzer 和 Synopsys Design Constraint(SDC) 的基础知识,以便正确地使用这些指南。,2019-11-16 18:52:34,下载4次
FPGA那些事儿--TimeQuest静态时序分析REV7.0.zip - HDL 描述的模块是软模型, modelsim 仿真的软模型是理想时序。换之,软模型经过综 合器总综合以后就会成为硬模型,也是俗称的网表。而 TimeQuest 分析的对象就是硬模 型的物理时序。用于数字电路设计和ASIC芯片设计,2019-11-16 18:49:26,下载1次
DE10_NANO_SoC_GHRD.zip - DE10开发板例程,可直接用。模块的直接添加或删减进行工程设计,2018-05-06 17:31:49,下载11次

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dpll_demo.rar - 一个实现简单的数字锁相环Verilog代码,本人借鉴网上现有的代码后经修改在Cyclone II上调通实现,里面有ModelSim仿真成功的波形图
GPS_CA_CODE_GEN.rar - gps接收机码发生器原代码,已经在实际工程中得到应用。供大家参考。
ca_code.zip - nco的产生原理的相关代码;软件无线电、直接数据频 率合成器(DDS,Direct digital synthesizer)、快速傅立叶变换(FFT,Fast Fourier Transform) 等的重要组成部分,同时也是决定其性能的主要因素之一,用于产生可控的正弦波或余弦波。随着芯片集成度的提高、在信号 处理、数字通信领域、调制解调、变频调速、制导控制、电力电子等方面得到越来越广泛的应用
Code_NCO.zip - 码数控振荡器相位累加器的位数N为32,利用verilog HDL语言在Quartus II 9.1中具体实现了载波和码NCO的设计。
2_Mixer.rar - 数字信号处理实验之滤波器实现。 希望对大家有帮助
quartus_16.0_17.0_密码12345.rar - quartus The solution of the Electronic Design Competition in the past years The solution of the Electronic Design Competition in the past years
pll.zip - DPLL由 鉴相器、 模K加减计数器、脉冲加减电路、同步建立侦察电路、模N分频器构成. 整个系统的中心频率(即signal_in和signal_out的码速率的2倍)为clk/8/N. 模K加减计数器的K值决定DPLL的精度和同步建立时间,K越大,则同步建立时间长,同步精度高.反之则短,低.
jianxiang.rar - 基于ISE的鉴频、鉴相器,开发板:xilinx公司spartan 3E 500.精确度1hz,1度。完全正确。
E1_DCR.rar - 2MHz的数据时钟恢复电路,包括鉴相器、分频器及滤波器
dpll.rar - 基于Verilog的数字锁相环。包括三个模块,数字鉴相器DPD、数字环路滤波器DLF、数控振荡器 DCO三部分构成
DPLL.rar - 全数字锁相环的verilog设计,已通过仿真验证能迅速锁定相位
lab2.rar - 这是基于verilog语言写的,是基于fpga的数字锁相环的设计,用modelsim打开
(costas)max_choice.rar - 科斯塔斯环环路滤波器的VHDL实现,仅供参考,同时有计算相关的VHDL实现代码。
NCO.zip - 卫星导航接收机 数控振荡器NCO模块 verilog程序完整版
Hagongda-hou.zip - gps基带信号处理的程序,卫星导航接收基带处理程序 十分宝贵
Gps_c_code_nco.rar - 在GPS接收机本地NCO及CA码产生,生成超前码,即时码和滞后码。
costas.rar - costas的verilog程序,包含乘法器,DDS,鉴相器,环路滤波器等模块
ca_gen.rar - 此Verilog程序产生用于GPS卫星导航信号的C/A码,输入信号有时钟、时钟使能、复位、给定的卫星编号,输出产生的C/A码。此程序在代码上进行优化,占用了更少的资源。
code_gen2.rar - GPS中C/A码生成电路,用于GPS接收机中的跟踪和捕获。
code_dco.rar - 通信电路中产生扩频码的电路,应用于GPS中的跟踪和捕获.

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