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PingPang_buffer_20160526 源码仿真 乒乓 缓存,实现数据流的传输,含有 测试文件,vivado工程。 VHDL-FPGA-Verilog 259万源代码下载- www.pudn.com
 文件名称: PingPang_buffer_20160526下载  收藏√  [投票:非常好  5  4  3  2  1 投票:太差了]
  所属分类: VHDL-FPGA-Verilog
  开发工具: VHDL
  文件大小: 2366 KB
  上传时间: 2016-06-03
  下载次数: 0
  提 供 者: 贾俊超
 详细说明:源码仿真 乒乓 缓存,实现数据流的传输,含有仿真测试文件,vivado工程。-Source simulation ping-pong cache data stream transmission, the file containing the simulation test, vivado project.
文件列表(点击判断是否您需要的文件,如果是垃圾请在下面评价投诉):
  PingPang_buffer_20160526\test.cache\wt\synthesis.wdf
  ........................\..........\..\webtalk_pa.xml
  ........................\..........\..\xsim.wdf
  ........................\.....runs\.jobs\vrs_config_1.xml
  ........................\.........\.....\vrs_config_2.xml
  ........................\.........\.....\vrs_config_3.xml
  ........................\.........\.....\vrs_config_4.xml
  ........................\.........\.....\vrs_config_5.xml
  ........................\.........\.....\vrs_config_6.xml
  ........................\.........\.....\vrs_config_7.xml
  ........................\.........\.....\vrs_config_8.xml
  ........................\.........\blk_mem_gen_0_synth_1\vivado.pb
  ........................\.........\srio_gen2_0_synth_1\vivado.pb
  ........................\.....sim\sim_1\behav\blk_mem_gen_0.mif
  ........................\........\.....\.....\compile.bat
  ........................\........\.....\.....\compile.sh
  ........................\........\.....\.....\pingpang_tb_v.prj
  ........................\........\.....\.....\pingpang_tb_v.tcl
  ........................\........\.....\.....\pingpang_tb_v_behav.log
  ........................\........\.....\.....\pingpang_tb_v_behav.wdb
  ........................\........\.....\.....\xelab.log
  ........................\........\.....\.....\xelab.pb
  ........................\........\.....\.....\.sim.dir\blk_mem_gen_v8_0\beh_ff_ce.vdb
  ........................\........\.....\.....\........\................\beh_ff_clr.vdb
  ........................\........\.....\.....\........\................\beh_ff_pre.vdb
  ........................\........\.....\.....\........\................\beh_muxf7.vdb
  ........................\........\.....\.....\........\................\blk_mem_axi_read_wrapper_beh.vdb
  ........................\........\.....\.....\........\................\blk_mem_axi_regs_fwd_v8_0.vdb
  ........................\........\.....\.....\........\................\blk_mem_axi_write_wrapper_beh.vdb
  ........................\........\.....\.....\........\................\blk_mem_gen_v8_0.vdb
  ........................\........\.....\.....\........\................\blk_mem_gen_v8_0_mem_module.vdb
  ........................\........\.....\.....\........\................\blk_mem_gen_v8_0_output_stage.vdb
  ........................\........\.....\.....\........\................\blk_mem_gen_v8_0_softecc_output_reg_stage.vdb
  ........................\........\.....\.....\........\................\read_netlist.vdb
  ........................\........\.....\.....\........\................\state_logic.vdb
  ........................\........\.....\.....\........\................\write_netlist.vdb
  ........................\........\.....\.....\........\...............2\@b@l@k_@m@e@m_@g@e@n_v8_2_mem_module.sdb
  ........................\........\.....\.....\........\................\@b@l@k_@m@e@m_@g@e@n_v8_2_output_stage.sdb
  ........................\........\.....\.....\........\................\@b@l@k_@m@e@m_@g@e@n_v8_2_softecc_output_reg_stage.sdb
  ........................\........\.....\.....\........\................\@s@t@a@t@e_@l@o@g@i@c_v8_2.sdb
  ........................\........\.....\.....\........\................\beh_vlog_ff_ce_clr_v8_2.sdb
  ........................\........\.....\.....\........\................\beh_vlog_ff_clr_v8_2.sdb
  ........................\........\.....\.....\........\................\beh_vlog_ff_pre_v8_2.sdb
  ........................\........\.....\.....\........\................\beh_vlog_muxf7_v8_2.sdb
  ........................\........\.....\.....\........\................\blk_mem_axi_read_wrapper_beh_v8_2.sdb
  ........................\........\.....\.....\........\................\blk_mem_axi_regs_fwd_v8_2.sdb
  ........................\........\.....\.....\........\................\blk_mem_axi_write_wrapper_beh_v8_2.sdb
  ........................\........\.....\.....\........\................\blk_mem_gen_v8_2.sdb
  ........................\........\.....\.....\........\................\read_netlist_v8_2.sdb
  ........................\........\.....\.....\........\................\write_netlist_v8_2.sdb
  ........................\........\.....\.....\........\fifo_generator_v10_0\@f@i@f@o_@g@e@n@e@r@a@t@o@r_@v10_0_@c@o@n@v_@v@e@r.sdb
  ........................\........\.....\.....\........\....................\fifo_generator_v10_0.sdb
  ........................\........\.....\.....\........\....................\fifo_generator_v10_0_axic_reg_slice.sdb
  ........................\........\.....\.....\........\....................\fifo_generator_v10_0_beh_ver_ll_afifo.sdb
  ........................\........\.....\.....\........\....................\fifo_generator_v10_0_bhv_ver_as.sdb
  ........................\........\.....\.....\........\....................\fifo_generator_v10_0_bhv_ver_preload0.sdb
  ........................\........\.....\.....\........\....................\fifo_generator_v10_0_bhv_ver_ss.sdb
  ........................\........\.....\.....\........\....................\fifo_generator_v10_0_sync_stage.sdb
  ........................\........\.....\.....\........\pingpang_tb_v_behav\Compile_Options.txt
  ........................\........\.....\.....\........\...................\xsim.dbg
  ........................\........\.....\.....\........\...................\xsim.mem
  ........................\........\.....\.....\........\...................\xsim.reloc
  ........................\........\.....\.....\........\...................\xsim.rtti
  ........................\........\.....\.....\........\...................\xsim.svtype
  ........................\........\.....\.....\........\...................\xsim.type
  ........................\........\.....\.....\........\...................\xsim.xdbg
  ........................\........\.....\.....\........\...................\xsimcrash.log
  ........................\........\.....\.....\........\...................\xsimk.exe
  ........................\........\.....\.....\........\...................\xsimkernel.log
  ........................\........\.....\.....\........\srio_gen2_v3_1\srio_gen2_unifiedtop.vdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_arb_rx.sdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_arb_rx_pipe.sdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_arb_tx.sdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_arb_tx_mux.sdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_arb_tx_user_if.sdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_buf.vdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_buf_cfg_reg.sdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_buf_cfg_top.sdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_buf_rx.sdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_buf_rx_async_passage.sdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_buf_rx_bram_bank.sdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_buf_top.sdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_buf_tx.sdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_buf_tx_bram_bank.sdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_buf_tx_sync_unit.sdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_cfg_axi.sdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_crc13_35.sdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_crc16_16.sdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_crc16_32.sdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_crc16_48.sdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_crc16_64.sdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_crc5_20.sdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_eval.sdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_eval_gt_pcs_clk.sdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_eval_log_clk.sdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_hello_decoder.sdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_hello_encoder.sdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_log.vdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_log_cfg_reg.sdb
  ........................\........\.....\.....\........\..............\srio_gen2_v3_1_log_cfg_top.sdb
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