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ASI_simulation 异步串行接口ASI仿真设计,quartus modelsim 参考 ,实现ASI传输,完成8b/10b转 VHDL-FPGA-Verilog 261万源代码下载- www.pudn.com
 文件名称: ASI_simulation下载  收藏√  [投票:非常好  5  4  3  2  1 投票:太差了]
  所属分类: VHDL-FPGA-Verilog
  开发工具: VHDL
  文件大小: 591 KB
  上传时间: 2016-06-23
  下载次数: 0
  提 供 者: wsc
 详细说明:异步串行接口ASI仿真设计,quartus modelsim 仿真参考设计,实现ASI传输,完成8b/10b转换,串并转换-Asynchronous Serial Interface ASI simulation design, quartus modelsim simulation reference design, implementation ASI transmission, complete 8b/10b conversion, serial-parallel conversion
文件列表(点击判断是否您需要的文件,如果是垃圾请在下面评价投诉):
  ASI_simulation\lib\.recurs
  ..............\...\asi_aligner.v
  ..............\...\asi_clocks.v
  ..............\...\asi_megacore_top.ocp
  ..............\...\asi_megacore_top.v
  ..............\...\asi_packet_sync.v
  ..............\...\asi_parse.v
  ..............\...\asi_receive.v
  ..............\...\asi_sync_fsm.v
  ..............\...\asi_transmit.v
  ..............\...\asi_wizard.lst
  ..............\...\c4gxb_rx_1port_1350_10bit.v
  ..............\...\c4gxb_tx_1port_1350_10bit.v
  ..............\...\clkdiv_2p5.v
  ..............\...\dec8b10b.v
  ..............\...\enc8b10b.v
  ..............\...\gxb2_rx_1port_1350_10bit.v
  ..............\...\gxb2_tx_1port_1350_10bit.v
  ..............\...\gxb4_rx_1port_1350_10bit.v
  ..............\...\gxb4_tx_1port_1350_10bit.v
  ..............\...\gxb_rx_1port_1350_10bit.v
  ..............\...\gxb_tx_1port_1350_10bit.v
  ..............\...\ip_8B10B_dec.v
  ..............\...\ip_8B10B_dec_aot1151_dec8b10b.ocp
  ..............\...\ip_8B10B_dec_aot1151_dec8b10b.v
  ..............\...\ip_8B10B_dec_bb.v
  ..............\...\ip_8B10B_dec_inst.v
  ..............\...\ip_8B10B_dec_tb.v
  ..............\...\ip_8B10B_enc.v
  ..............\...\ip_8B10B_enc_aot1151_enc8b10b.ocp
  ..............\...\ip_8B10B_enc_aot1151_enc8b10b.v
  ..............\...\ip_8B10B_enc_bb.v
  ..............\...\ip_8B10B_enc_inst.v
  ..............\...\ip_8B10B_enc_tb.v
  ..............\...\...toolbench\asi.jar
  ..............\...\pll_sclk.v
  ..............\...\pll_x10.v
  ..............\...\serdes_p2s.v
  ..............\...\serdes_rxsample.v
  ..............\...\serdes_s2p.v
  ..............\...\serdes_txfifo.v
  ..............\...\serdes_txsample.v
  ..............\...\stratix_c2_pll_sclk.v
  ..............\...\stratix_c2_pll_x10.v
  ..............\...\wizard.xml
  ..............\simulation\modelsim\modelsim\asi_sim.bat
  ..............\..........\........\........\modelsim.ini
  ..............\..........\........\........\wave.do
  ..............\..........\........\testbench\asi_mc_build\asi_rx_sim.bsf
  ..............\..........\........\.........\............\asi_rx_sim.html
  ..............\..........\........\.........\............\asi_rx_sim.ppf
  ..............\..........\........\.........\............\asi_rx_sim.qip
  ..............\..........\........\.........\............\asi_rx_sim.v
  ..............\..........\........\.........\............\asi_rx_sim.vo
  ..............\..........\........\.........\............\asi_rx_sim_advisor.ipa
  ..............\..........\........\.........\............\asi_rx_sim_bb.v
  ..............\..........\........\.........\............\asi_tx_sim.bsf
  ..............\..........\........\.........\............\asi_tx_sim.html
  ..............\..........\........\.........\............\asi_tx_sim.ppf
  ..............\..........\........\.........\............\asi_tx_sim.qip
  ..............\..........\........\.........\............\asi_tx_sim.v
  ..............\..........\........\.........\............\asi_tx_sim.vo
  ..............\..........\........\.........\............\asi_tx_sim_advisor.ipa
  ..............\..........\........\.........\............\asi_tx_sim_bb.v
  ..............\..........\........\.........\tb_asi_mc.v
  ..............\..........\........\.........\.s_packet_gen\auk_ts_packet_check.v
  ..............\..........\........\.........\.............\auk_ts_packet_gen.v
  ..............\..........\quartus\asi_rx.bsf
  ..............\..........\.......\asi_rx.html
  ..............\..........\.......\asi_rx.pin
  ..............\..........\.......\asi_rx.ppf
  ..............\..........\.......\asi_rx.qip
  ..............\..........\.......\asi_rx.qsf
  ..............\..........\.......\asi_rx.v
  ..............\..........\.......\asi_rx.vo
  ..............\..........\.......\asi_rx_bb.v
  ..............\..........\.......\asi_sim.qpf
  ..............\..........\.......\testbench\asi_mc_build\asi_tx_sim.bsf
  ..............\..........\.......\.........\............\asi_tx_sim.html
  ..............\..........\.......\.........\............\asi_tx_sim.ppf
  ..............\..........\.......\.........\............\asi_tx_sim.qip
  ..............\..........\.......\.........\............\asi_tx_sim.v
  ..............\..........\.......\.........\............\asi_tx_sim.vo
  ..............\..........\.......\.........\............\asi_tx_sim_bb.v
  ..............\..........\.......\.........\pll_x10_top.v
  ..............\..........\.......\.........\READme.txt
  ..............\..........\.......\.........\stratix_c2_pll_sclk.v
  ..............\..........\.......\.........\tb_asi_mc.v
  ..............\..........\.......\.........\.s_packet_gen\auk_ts_packet_check.v
  ..............\..........\.......\.........\.............\auk_ts_packet_gen.v
  ..............\..........\modelsim\testbench\asi_mc_build
  ..............\..........\........\.........\ts_packet_gen
  ..............\..........\quartus\testbench\asi_mc_build
  ..............\..........\.......\.........\ts_packet_gen
  ..............\..........\modelsim\modelsim
  ..............\..........\........\testbench
  ..............\..........\quartus\testbench
  ..............\lib\ip_toolbench
  ..............\simulation\modelsim
  ..............\..........\quartus
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