ov7670-master.zip

  • Thanh Phuc
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ov-7670 master verilog
ov7670-master.zip
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  • i2c.v
    3.6KB
  • uart_tx.v
    1.3KB
  • i2c_clk.v
    435B
  • baud_gen_uart.v
    345B
  • top.v
    2.6KB
  • frame_cap.v
    1.4KB
  • fsm.v
    1.5KB
  • README.md
    211B
内容介绍
# ov7670 Verilog Implementation to capture a frame from ov7670 camera module. The project was implemented on Numato MimasV2 FPGA Board. Due to Block Ram limitations , a 160x120 frame is captured in YUV format.
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