chinatiger11

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FPGA-FILTERSs.zip - 采用FPGA,用DSP算法实现数字滤波器,英文资料,2011-05-10 16:42:08,下载6次
Verilog-state-machine.zip - 状态机采用 VerilogHDL 语言编码,建议分为三个 always 段,本文档就是详述其原因,2011-05-10 16:36:52,下载4次
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LibMPSSE-I2C_DLL_Windows.zip - ftdi公司的USB转IIC的一个实例,是在windows环境下运行的,简单易懂。

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