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reqtest-pecialization.zip
- 通讯原理之模拟电平码程序,不错的源码,可以学习使用,2019-01-01 06:37:05,下载0次
CSXS.zip
- 选择排序是一种比较优化的排序,它定义的k意义在于表示一次循环后找到的最小(大)值的位置,然后让第i个(第几次循环就是第几个,2019-01-01 06:34:16,下载0次
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- 为Verilog Hdl 代码实现自动洗衣机启动,复位,水洗,排水,脱水,等功能,并能显示洗衣机的工作状态
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- 一个好用的经过FPGA验证的i2c_slave verilog代码。
i2c_master_module.zip
- i2c接口的fpga实现,工作在master模式下,verilog
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- FPGA汉字滚动显示 1)用8×8点阵显示屏滚动显示至少4个汉字; 2)可以用拨码开关控制左、右滚动显示。
main_1.zip
- (1) 输入一字符串,判断是否为Java关键字(Java关键字保存在文件"Java关键字.txt"中)。
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