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proteus
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数控直流稳压电源
Johnson
译码器
约翰逊
Johnson计数器
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:2020-06-10 21:40:29
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数控直流稳压电源proteus仿真 程序资料.zip
- 基于proteus平台的直流稳压电源的仿真文件,包括pcb,2020-06-10 21:46:11,下载3次
近期下载
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多种波形产生电路.zip
- 波形产生器 原2015年全国大学生电子设计竞赛综合测评题
johnson.rar
- JOHNSON计数器,8bit,在FPGA板子上简单的实现,给大家作为练习
奇数分频.zip
- 使用verilog语言描述了一个任意奇数分频,且占空比为50%。
38译码器.rar
- 38译码器原理图,仿真图文件,可直接在Quartus II中打开查看。
Verilog.zip
- 七段数码管译码器.(Verilog)[FPGA]第一个Verilog程序,七段共阴数码管摸索了好几天,终于能完成敲入代码、综合、仿真、绑定引脚至下载的全套工作了
dividerverilogdesign.zip
- verilog 分频器设计 偶数分频器和奇数分频器
divider.rar
- 分频器的设计包括奇数分频,偶数分频,小数分频
Verilog作业2.zip
- 设计一个具有同步置1,异步清零的D触发器。 设计一个类似74LS160的计数器
74HC161.zip
- 74ls161 基于verilog语言的实现 源程序在压缩包的hdl文件夹中
pll.zip
- fpga配置锁相环完整程序,使用quartus IP核,Verilog语言。
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