13_fifo_test.rar - 基于FPGA，利用verilog hdl 实现FPGA片内FIFO读写实验,2021-03-14 14:04:15,下载0次
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05_seg_test.rar - 基于FPGA,利用verilog hdl语言，实现数码管的扫描实验,2021-03-14 13:57:16,下载0次
04_uart_test.rar - 基于FPGA，用verilog hdl语言实现串口收发实验,2021-03-14 13:43:49,下载2次
06_key_debounce.rar - 基于FPGA，利用verilog HDL语言实现按键消抖实验,2021-03-14 13:39:49,下载0次