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ethernet01.rar - Virtex2的网卡接口程序，使用C语言编写。,2006-07-24 16:25:36,下载8次
bist_rev_1_5.rar - Viertex 2 开发板的接口程序，使用VC编写。,2006-07-24 16:21:44,下载20次
learnning03.rar - 使用matlab语言设计的，跳频扩频通信系统仿真程序。,2006-07-24 16:16:07,下载251次
fhss02.rar - 跳频扩频通信系统仿真程序，使用matlab语言设计的程序。,2006-07-24 16:13:20,下载465次
dsss01.rar - 直接序列扩频通信系统仿真程序，使用matlab语言设计的程序。,2006-07-24 16:09:19,下载694次

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用C语言编的QAM调制解调的程序.rar - 用C语言编的QAM调制解调的程序,实用方便
QAM.rar - 实现QAM调制功能和QAM解调功能的代码.
QAM_verilog.rar - 基于FPGA的16QAM，用verilog编写，其中DDS为自己编写，含设计文件和testbench。已通过moldesim软件仿真。
QAM-Mod.rar - QAM Modulator verilog code
qam_64.rar - 64QAM调制,采用硬件语言verilog实现,其中调用了DDS的IP核
MultiThread.rar - 多线程控制，如何使用多线程，线程的同步返回
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2003061723305924139多线程Socket.rar - 2003061723305924139多线程Socket，多线程，通信开发
Uart_Analysis.zip - rs422通信，此模块实现通信功能，使用Verilog语言
Uart.zip - RS422通信程序，Verilog语言，此模块实现422通信功能
verilog_422.rar - 标准RS422 Verilog源代码， 传输波特率可以修改， FPGA上可以工作
RS-422standardmodulev2.rar - rs422标准通讯模块 异步收发 verilog语言编写
uart8.zip - 使用Libero提供的异步通信IP核实现UART通信，并附带仿真程序。UART设置为1位开始位，8位数据位，1位停止位，无校验。且UART发送自带2级FIFO缓冲，占用FPGA面积很小。
uart_verilog.rar - UART Verilog，书中里的例子，绝对正确，用Verilog语言编写的串口通信例子
u-uart.zip - UART verilog TX/RX OpenCores share
uart_verilog.zip - Uart Verilog code example
UART_verilog.rar - 一个uart的Verilog代码，希望能够帮助你做UART逻辑。
TX_ASYNC_for_module_UART.rar - Tx Async fpr module UART written in Verilog Libero core generator.
RX_ASYNC_for_module_UART.rar - Rx Async for module UART written in Verilog Libero Designer core generator.
UART.rar - General purpose UART written in Verilog Libero core generator.

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